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?基于通用驗(yàn)證方法學(xué)（UVM）搭建用于 FPGA 開發(fā)驗(yàn)證的環(huán)境及測(cè)試用例，且該環(huán)境應(yīng)易于維護(hù)及復(fù)用。
?進(jìn)行仿真，并收集功能覆蓋率及代碼覆蓋率的分析報(bào)告。
?與 FPGA 設(shè)計(jì)工程師合作開發(fā)場(chǎng)景級(jí)別的測(cè)試用例。
?對(duì) FPGA 軟件進(jìn)行靜態(tài)時(shí)序分析、規(guī)則檢查以及邏輯等效性驗(yàn)證。
?協(xié)助編寫測(cè)試計(jì)劃，執(zhí)行測(cè)試計(jì)劃編寫測(cè)試激勵(lì)，生成測(cè)試數(shù)據(jù)，并撰寫完成測(cè)試工作所需的相關(guān)報(bào)告。
?負(fù)責(zé)代碼覆蓋率和功能覆蓋率的收斂。
?提交測(cè)試報(bào)告。
?跟蹤漏洞（BUG）狀態(tài)并進(jìn)行回歸測(cè)試。
?使用 ModelSim 工具進(jìn)行仿真測(cè)試。
?運(yùn)用 Verilog 語(yǔ)言、寄存器傳輸級(jí)（RTL）編碼、邏輯綜合以及靜態(tài)時(shí)序分析等技能。
?具備良好的溝通能力、問題發(fā)現(xiàn)能力以及優(yōu)秀的文檔編寫能力。
硬件電子工程師：
?進(jìn)行板級(jí) FPGA 需求采集、架構(gòu)定義、設(shè)計(jì)、綜合、布局布線以及時(shí)序分析，選擇關(guān)鍵技術(shù)及組件。
?致力于 FPGA 固件架構(gòu)，通過結(jié)合建模、仿真、原型制作、測(cè)試及分析等方法，滿足顯示產(chǎn)品關(guān)鍵市場(chǎng)及應(yīng)用的需求，并符合技術(shù)和財(cái)務(wù)方面的限制條件。
?在 FPGA 中設(shè)計(jì)并實(shí)現(xiàn)實(shí)時(shí)嵌入式圖形解決方案，包括但不限于圖像幀完整性監(jiān)視器和圖像場(chǎng)景合成器。
?開發(fā)產(chǎn)品，展示并評(píng)估先進(jìn)的設(shè)計(jì)，在顯示組裝單元上集成并測(cè)試 FPGA 以驗(yàn)證概念，并將其轉(zhuǎn)化到顯示產(chǎn)品的開發(fā)中。
?與軟件工程師、系統(tǒng)工程師、驗(yàn)證及測(cè)試工程師緊密合作，以定義整個(gè)系統(tǒng)架構(gòu)，集成模塊及組件，并交付高性能、可擴(kuò)展且高能效的產(chǎn)品。