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1、根據(jù)系統(tǒng)架構(gòu)、子系統(tǒng)和模塊功能，制定驗(yàn)證計(jì)劃、驗(yàn)證策略和驗(yàn)證方案；
2、負(fù)責(zé)把控系統(tǒng)、子系統(tǒng)和模塊級驗(yàn)證功能點(diǎn)和驗(yàn)證執(zhí)行；
3、負(fù)責(zé)系統(tǒng)驗(yàn)證、模塊級驗(yàn)證平臺和VIP開發(fā)維護(hù)以及驗(yàn)證效率提升，負(fù)責(zé)回歸測試和驗(yàn)證覆蓋率分析；
4、負(fù)責(zé)驗(yàn)證進(jìn)度、驗(yàn)證文檔及報(bào)告交付；
5、負(fù)責(zé)與FPGA驗(yàn)證協(xié)作并相互溝通驗(yàn)證策略和方案，減少和避免驗(yàn)證漏洞；
6、負(fù)責(zé)驗(yàn)證團(tuán)隊(duì)管理和團(tuán)隊(duì)建設(shè)工作。
7、負(fù)責(zé)驗(yàn)證框架和體系功能建設(shè)。

【崗位要求】

1. 本科及以上學(xué)歷，3年以上數(shù)字芯片MCU和復(fù)雜模塊級UVM驗(yàn)證經(jīng)驗(yàn)；
2. 熟練使用verilog、System Verilog語言；
3. 精通UVM驗(yàn)證方法學(xué)，具有搭建MCU系統(tǒng)和模塊級UVM驗(yàn)證平臺和編寫VIP的能力
4. 熟悉MCU架構(gòu)、ARM CPU及AMBA總線，熟悉嵌入式C語言、SV和匯編語言；
5. 熟練使用常用驗(yàn)證工具如VCS、Verdi、EMAN等；
6. 熟練掌握TCL/Shell/Perl/Python等腳本語言；
7. 具備較強(qiáng)的驗(yàn)證調(diào)試和問題分析能力，具備構(gòu)建驗(yàn)證體系架構(gòu)的能力;
8. 具有較強(qiáng)的自我驅(qū)動(dòng)能力、抗壓能力和良好溝通能力，有團(tuán)隊(duì)負(fù)責(zé)人經(jīng)驗(yàn)者優(yōu)先