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福利待遇：

1. 上班時(shí)間：做五休二 早上9：00-18：00

2. 收入水平：底薪 + 銷售提成 + 團(tuán)隊(duì)獎(jiǎng)金 + 年底分紅；

3. 晉升機(jī)會(huì)：為員工提供完善的業(yè)務(wù)培訓(xùn)體系和公平開放的職位晉升通道；

4. 福利保障：按國家標(biāo)準(zhǔn)繳納五險(xiǎn)一金、公積金，補(bǔ)充醫(yī)療保險(xiǎn)，通訊補(bǔ)貼，餐貼，員工生日、節(jié)日福利；

5. 旅游獎(jiǎng)勵(lì)：公司員工每月團(tuán)建經(jīng)費(fèi)，每年安排全員團(tuán)隊(duì)建設(shè)；

6. 年終獎(jiǎng)金：0-2個(gè)月的年終獎(jiǎng)金（按年度工作業(yè)績(jī)考評(píng)）；股權(quán)激勵(lì)：公司處于快速發(fā)展期，突出貢獻(xiàn)者有機(jī)會(huì)獲期權(quán)、股權(quán)激勵(lì)。

u 模擬設(shè)計(jì)工程師 薪資：20-35K

崗位職責(zé)：

1） 負(fù)責(zé)模擬集成電路設(shè)計(jì)及仿真驗(yàn)證；

2） 模擬設(shè)計(jì)主要包括高性能信號(hào)鏈、高性能電源、高精度低功耗時(shí)鐘鏈三個(gè)方向；

3） 負(fù)責(zé)測(cè)試、驗(yàn)證所設(shè)計(jì)電路的功能及性能；

4） 撰寫模擬電路設(shè)計(jì)、測(cè)試文檔；

任職要求：

1）碩士以上學(xué)歷，電子、通信、微電子或相關(guān)專業(yè)；

2）具有扎實(shí)的模擬集成電路設(shè)計(jì)理論基礎(chǔ)；

3）至少熟悉MATLAB、verilog-A、C之一，必須熟練掌握基礎(chǔ)模擬電路設(shè)計(jì)方法（如放大器各種TB，ADC SNDR評(píng)估等）及模擬EDA分析方法（如TRAN\AC\DC\PSS\PNOISE等）；

4）至少精通OPA/ADC/DAC/PM/OSC/PLL之一；

5）精通建模（包括simulink系統(tǒng)建模、verilog-A行為級(jí)建模），熟悉系統(tǒng)驗(yàn)證者優(yōu)先；

6）精通濾波器（CT/SC）、熟悉開關(guān)電容電路優(yōu)先；

7）精通高精度信號(hào)鏈處理，掌握常規(guī)低噪設(shè)計(jì)方法（如CDS\CHS等）優(yōu)先；