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    更新于 1月16日

    FPGA工程師(新鄉(xiāng))

    1.1萬(wàn)-1.9萬(wàn)

    職位描述

    1. 根據(jù)項(xiàng)目需求,完成FPGA邏輯構(gòu)架和產(chǎn)品開發(fā);
    2. 負(fù)責(zé)通信相關(guān)的FPGA開發(fā)、系統(tǒng)應(yīng)用、調(diào)試等工作;
    3. 負(fù)責(zé)FPGA設(shè)計(jì)方案實(shí)現(xiàn)、邏輯代碼實(shí)現(xiàn)以及相關(guān)文檔的編寫;
    4. 對(duì)邏輯代碼進(jìn)行功能仿真、綜合實(shí)現(xiàn)等檢查、故障分析、問(wèn)題處理;
    5. 與硬件工程師配合,進(jìn)行產(chǎn)品或樣件的調(diào)試、實(shí)驗(yàn)工作;
    6. 與相關(guān)設(shè)計(jì)人員配合,保障項(xiàng)目進(jìn)展與質(zhì)量;
    完成項(xiàng)目相關(guān)設(shè)計(jì)文檔編寫
    7. 根據(jù)項(xiàng)目進(jìn)展需要,配合團(tuán)隊(duì)完成其他工作。
    任職要求:
    1. 本科及以上學(xué)歷,電子信息、通信相關(guān)專業(yè);
    2. 有航天、jun工領(lǐng)域通信行業(yè)FPGA邏輯設(shè)計(jì)工作經(jīng)驗(yàn)優(yōu)先錄用;
    3. 四六級(jí)成績(jī)良好,能夠獨(dú)立閱讀全英參考文獻(xiàn);
    4. 精通Verilog、VHDL語(yǔ)言,具有較強(qiáng)的編碼能力;
    5. 熟悉Xilinx/Altera器件、quartus/modlelsim/ISE/Vivado等開發(fā)工具;
    6. 熟悉質(zhì)量管理體系、FPGA程序開發(fā)流程及科研生產(chǎn)流程;
    熟悉數(shù)模電路的設(shè)計(jì)及分析、電路調(diào)試與系統(tǒng)自測(cè);
    7. 具備良好的溝通能力、邏輯思維能力以及團(tuán)隊(duì)協(xié)作能力,高度責(zé)任心和敬業(yè)精神。

    工作地點(diǎn)

    創(chuàng)客小鎮(zhèn)(創(chuàng)業(yè)園1號(hào)園),新飛大道與創(chuàng)業(yè)路交叉口東100米,創(chuàng)新樓三層305室

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