雇員點(diǎn)評(píng)標(biāo)簽
職位描述
VerilogVHDL
崗位職責(zé)：
1、負(fù)責(zé)根據(jù)系統(tǒng)需求，設(shè)計(jì)FPGA的硬件架構(gòu)，并進(jìn)行性能、功耗和資源的分析;
2、使用Verilog或VHDL等硬件描述語(yǔ)言，編寫FPGA的設(shè)計(jì)代碼，并進(jìn)行仿真和驗(yàn)證；
3、編寫相關(guān)的技術(shù)文檔，如設(shè)計(jì)規(guī)范、接口規(guī)范、用戶手冊(cè)等；
任職要求：
1、碩士以上學(xué)歷，控制科學(xué)與工程、電子信息、通訊工程、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)；
2、熟悉FPGA的原理、架構(gòu)和設(shè)計(jì)流程，熟練掌握FPGA硬件描述語(yǔ)言和設(shè)計(jì)工具；
3、具備良好的英語(yǔ)讀寫能力，能夠理解和使用英文文獻(xiàn)、技術(shù)資料等。
工作地點(diǎn)
濟(jì)南市高新區(qū)伯樂(lè)路282號(hào)
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