崗位職責(zé):?從事信號處理板硬軟件設(shè)計開發(fā)
任職要求:
1、計算機、通信、電子相關(guān)專業(yè)碩士研究生學(xué)歷;
?2、 精通VHDL或Verilog HDL語言,精通RTL代碼設(shè)計和算法驗證;
3、熟悉Altera或Xilinx FPGA開發(fā)流程(仿真,綜合,布局布線,時序分析),熟練使用相應(yīng)的綜合、實現(xiàn)、仿真工具(包括第三方的Synplify Pro、ModelSim等);
4、能夠獨立負責(zé)開發(fā)、調(diào)試FPGA芯片;
5、具有良好的代碼風(fēng)格,獨立編寫、仿真并實際調(diào)試過大規(guī)模的RTL代碼模塊;
6、良好的技術(shù)文檔編寫能力, 誠懇、踏實、認真、有良好的溝通能力和團隊合作。
7、良好的數(shù)字電路基礎(chǔ)。
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