職位描述
FPGAVerilog電路設(shè)計
崗位職責：
1. 負責公司圖像處理、高速數(shù)采等平臺的產(chǎn)品開發(fā)；
2. 負責FPGA的框架搭建、代碼編輯、仿真、算法優(yōu)化、調(diào)試等工作；
3. 負責主導(dǎo)新項目的評估、評審、推進、協(xié)調(diào)、總結(jié)等工作；
4. 負責分析解決項目中與軟件相關(guān)的技術(shù)問題；
任職要求：
1. 本科及以上學(xué)歷，3年以上相關(guān)工作經(jīng)驗，電子工程、通信、計算機、自動化等相關(guān)專業(yè)；
2. 熟練使用Verilog進行邏輯電路設(shè)計，或熟練使用C語言；
3. 熟練Vivado/Quarrus/Modelsim/Debussy等EDA工具；
4. 熟悉圖像處理，高速數(shù)采，各類時序，接口知識；
5. 具備完整的FPGA項目開發(fā)、調(diào)試經(jīng)驗；
6. 有復(fù)旦微、安路、高云、Xilinx的FPGA或ZYNQ等多個平臺開發(fā)經(jīng)驗者優(yōu)先；
7. 善于溝通、協(xié)作，具有較好的分析問題和解決問題的能力。
職位福利：五險一金、績效獎金、帶薪年假、定期體檢、節(jié)日福利、全勤獎、周末雙休、通訊補助
工作地點
西安市高新區(qū)云水一路與天谷七路向西200米西安國家數(shù)字出版基地A座1404室
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職位發(fā)布者
王彥俠/行政副總
昨日活躍立即溝通
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