職位描述
C語(yǔ)言C++Verilog HDL
1、負(fù)責(zé)無(wú)線(xiàn)5G/5.5G新一代數(shù)字前端/FPGA的技術(shù)驗(yàn)證、產(chǎn)品開(kāi)發(fā)&測(cè)試、生產(chǎn)&網(wǎng)上交付等。
2、承擔(dān)邏輯模塊的方案設(shè)計(jì)、器件選型、詳細(xì)設(shè)計(jì)、代碼編程和上板調(diào)測(cè)，實(shí)現(xiàn)計(jì)算核、cache、內(nèi)存控制器、各類(lèi)算法、各類(lèi)高速接口協(xié)議的邏輯產(chǎn)品交付。 3、承擔(dān)FPGA/ASIC各類(lèi)通用模塊的平臺(tái)化設(shè)計(jì)和優(yōu)化，負(fù)責(zé)自研芯片技術(shù)原型和FPGA驗(yàn)證平臺(tái)的構(gòu)建和維護(hù)。
工作地點(diǎn)
西安雁塔區(qū)丈八七路與錦業(yè)路交匯處
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