職位描述
Verilog HDLVHDL
1、有FPGA數(shù)據(jù)算法處理經(jīng)驗(yàn)；
2、有matlab算法轉(zhuǎn)FPGA邏輯的經(jīng)驗(yàn)；
3、精通可編程邏輯設(shè)計(jì)方法和設(shè)計(jì)語言；
工作地點(diǎn)
全國
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職位發(fā)布者
李女士/人事
立即溝通
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