職位描述
VerilogVHDL
崗位職責:
1.負責FPGA類相關(guān)工作的開發(fā)，包括接口邏輯、控制算法、信號處理、總線及通信協(xié)議類的開發(fā)工作；
2.開展邏輯方案設(shè)計、代碼編寫、仿真驗證、板級或設(shè)備級調(diào)試工作；
3.配合開展相關(guān)文檔編寫、系統(tǒng)調(diào)試、測試和維護類工作。
任職要求:
1.本科及以上學歷，電子、計算機、通信、自動化類相關(guān)專業(yè)；
2.具有一定的數(shù)字電路、信號與系統(tǒng)、數(shù)字信號處理等專業(yè)知識；
3.熟悉VHDL或Verilog硬件描述語言，熟悉FPGA設(shè)計相關(guān)的開發(fā)工具和開發(fā)流程。
工作地點
賽達國際工業(yè)城
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