職位描述
VHDLVerilog HDL
崗位職責：
1、負責FPGA接口邏輯設(shè)計；
2、負責FPGA算法邏輯設(shè)計；
3、承擔FPGA相關(guān)研發(fā)工作。
4、承擔FPGA邏輯架構(gòu)設(shè)計、仿真、調(diào)試；
5、負責FPGA方案設(shè)計，參與項目的整體規(guī)劃與實施。
任職條件：
1、統(tǒng)招本科及以上學歷，電子工程類、或計算機類相關(guān)專業(yè)；
2、具有3年以上大規(guī)模FPGA系統(tǒng)實際項目編程經(jīng)驗；
3、熟練掌握高速接口處理（如高速ADC采集處理）；
4、熟練數(shù)字信號處理算法的設(shè)計應(yīng)用，尤其掌握高頻脈沖信號處理算法者優(yōu)先；
5、熟練Xilinx或Altera的FPGA器件，至少使用過一款FPGA器件；
6、熟練掌握VHDL或Verilog語言，掌握IP core和嵌入式邏輯分析儀的使用；
7、具有AD/DA的相關(guān)FPGA接口設(shè)計及調(diào)試經(jīng)驗者優(yōu)先；
1、負責FPGA接口邏輯設(shè)計；
2、負責FPGA算法邏輯設(shè)計；
3、承擔FPGA相關(guān)研發(fā)工作。
4、承擔FPGA邏輯架構(gòu)設(shè)計、仿真、調(diào)試；
5、負責FPGA方案設(shè)計，參與項目的整體規(guī)劃與實施。
任職條件：
1、統(tǒng)招本科及以上學歷，電子工程類、或計算機類相關(guān)專業(yè)；
2、具有3年以上大規(guī)模FPGA系統(tǒng)實際項目編程經(jīng)驗；
3、熟練掌握高速接口處理（如高速ADC采集處理）；
4、熟練數(shù)字信號處理算法的設(shè)計應(yīng)用，尤其掌握高頻脈沖信號處理算法者優(yōu)先；
5、熟練Xilinx或Altera的FPGA器件，至少使用過一款FPGA器件；
6、熟練掌握VHDL或Verilog語言，掌握IP core和嵌入式邏輯分析儀的使用；
7、具有AD/DA的相關(guān)FPGA接口設(shè)計及調(diào)試經(jīng)驗者優(yōu)先；
工作地點
北京市海淀區(qū)知春路63號衛(wèi)星大廈508
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