職位描述
Verilog HDL
任職資格：
1、根據(jù)項(xiàng)目需求，完成功能需求分解、實(shí)現(xiàn)方法分析及資源使用評(píng)估；
2、負(fù)責(zé)FPGA功能模塊的頂層設(shè)計(jì)、代碼編寫、仿真、調(diào)試及測(cè)試，解決開(kāi)發(fā)過(guò)程中的各類問(wèn)題；
3、參與項(xiàng)目的全周期開(kāi)發(fā)，對(duì)所設(shè)計(jì)的FPGA模塊進(jìn)行功能、性能及時(shí)序優(yōu)化設(shè)計(jì)，使其功能、性能及穩(wěn)定性符合產(chǎn)品要求；
4、完成FPGA模塊的設(shè)計(jì)方案、測(cè)試報(bào)告等相關(guān)文檔的編寫，確保開(kāi)發(fā)及測(cè)試文檔的齊套性；
5、根據(jù)項(xiàng)目需求，完成產(chǎn)品的測(cè)試、對(duì)接、聯(lián)試、售后維護(hù)等相關(guān)工作
崗位要求：
1、統(tǒng)招本科及以上學(xué)歷，通信/電子信息工程相關(guān)專業(yè)畢業(yè)，3-5年同崗位工作經(jīng)驗(yàn)，優(yōu)秀的應(yīng)屆畢業(yè)生也可接受；
2、熟悉ise，vivado，matlab，modelsim開(kāi)發(fā)軟件的使用；熟悉片上軟核microblaze的系統(tǒng)搭建和外設(shè)的驅(qū)動(dòng)設(shè)計(jì)；
3、熟悉硬件描述語(yǔ)言設(shè)計(jì)，c語(yǔ)言設(shè)計(jì)；熟悉軟件無(wú)線電有關(guān)的理論、算法設(shè)計(jì)；
4、誠(chéng)實(shí)守信，具有較強(qiáng)的責(zé)任心以及保密意識(shí)。
工作地點(diǎn)
北京大興區(qū)榮華南路15號(hào)中航技廣場(chǎng)
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