崗位職責:
1. 參與人工智能芯片IP級(片上或片間高速互聯(lián)/先進存儲/可編程處理核心/數(shù)據(jù)處理引擎/系統(tǒng)管理單元等)或SOC級功能驗證
2. 與IC設計工程師溝通,參與所負責的IP或SOC驗證功能點分解和驗證計劃制定,并撰寫相應的測試計劃
3. 基于UVM驗證方法學,參與所負責IP或SOC級別的仿真驗證環(huán)境搭建
4. 使用SystemVerlog和 C/C++語言開發(fā)測試向量并進行回歸測試
5. 參與計劃及實施各種覆蓋率分析
任職要求:
1. 本科或以上學歷,微電子、電子、計算機等相關專業(yè)優(yōu)先
2. 熟悉SystemVerilog/C/C++,并有實際使用經(jīng)驗;熟悉或了解UVM驗證方法學者優(yōu)先
3. 了解集成電路設計、驗證流程,有實際項目實習經(jīng)驗者優(yōu)先
4. 針對可編程處理核心驗證相關職位,熟悉計算機體系結構和典型處理器指令集,如 RISC-V / ARM / MIPS 者特別優(yōu)先
5. 有腳本語言開發(fā)經(jīng)驗者優(yōu)先,包括 perl, python, tcl, makefile等
6. 熟練使用Unix/Linux工作環(huán)境者優(yōu)先
7. 積極主動,有責任心;學習能力強,對問題有鉆研精神;溝通順暢,團隊合作意識好
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