職位描述
FPGAVHDLQuartusVerilogC語言電路設(shè)計(jì)
崗位職責(zé):
1.負(fù)責(zé)FPGA軟件代碼編寫、模塊設(shè)計(jì)及仿真；
2.FPGA硬件調(diào)試，以滿足各種需要的功能及性能；
3.進(jìn)行系統(tǒng)的功能定義，算法實(shí)現(xiàn)；
4.分析并解決開發(fā)過程中的問題，F(xiàn)PGA的資源及時(shí)序優(yōu)化；
5.配合軟、硬件設(shè)計(jì)人員完成相關(guān)任務(wù)目標(biāo)；
6.完成方案文檔、項(xiàng)目文檔、質(zhì)量記錄及相關(guān)文檔。
崗位要求:
1.本科及以上學(xué)歷。
2.熟悉verilog硬件描述語言（有一定的c語言基礎(chǔ)更好）。
3.熟悉xilinx的zynq系列芯片及其他常用fpga系列。
4.熟練使用xilinx的vivado開發(fā)環(huán)境。
5.熟悉對(duì)xilinx基本的IP核的使用。
6.能看懂簡(jiǎn)單的電路原理圖，方便進(jìn)行管腳和電壓約束。
7.良好的溝通能力，以便與硬件電路設(shè)計(jì)工程師和嵌入式工程師進(jìn)行工作對(duì)接。
職位福利：五險(xiǎn)一金、績(jī)效獎(jiǎng)金、帶薪年假、周末雙休、節(jié)日福利、定期體檢、股票期權(quán)、大牛帶隊(duì)
工作地點(diǎn)
齊魯軟件園
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