職位描述
VerilogSystemVerilog熟練掌握相關EDA工具
崗位職責：
1.負責芯片前端邏輯設計，根據(jù)芯片概要/詳細設計文檔撰寫完成RTL編碼實現(xiàn)、SDC編寫等工作；
2.與邏輯綜合、版圖設計工程師共同開展芯片設計的前后端聯(lián)合優(yōu)化；
3.與驗證工程師共同開展芯片驗證功能點提取，審核驗證大綱、驗證環(huán)境方案等。
2.與邏輯綜合、版圖設計工程師共同開展芯片設計的前后端聯(lián)合優(yōu)化；
3.與驗證工程師共同開展芯片驗證功能點提取，審核驗證大綱、驗證環(huán)境方案等。
任職要求：
1.計算機、微電子及集成電路等相關專業(yè)，985、211院校本科及以上學歷；
2.熟悉Verilog/SystemVerilog等數(shù)字電路硬件描述設計語言；
3.熟悉數(shù)字IC前端設計流程和工具，熟練掌握相關EDA 工具和常用腳本語言；
4.有實際芯片設計經驗者優(yōu)先，設計經驗包括但不限于：處理器核、Cache緩存、片上互連網(wǎng)絡、PCIE、DDR、ETH、NPU、GPU、低功耗設計等；
5.具有良好的團隊協(xié)作精神和溝通技巧。
其他事項：
優(yōu)秀者薪資面議
此崗位在北京、長沙兩地招聘。
工作地點
北京市豐臺區(qū)豐臺東大街
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