職位描述
Verilog HDLVHDL
崗位職責(zé)：
1.設(shè)計(jì)和開發(fā)FPGA硬件，編寫高質(zhì)量、可維護(hù)的硬件描述代碼（Verilog/VHDL）。
2.分析系統(tǒng)需求，將其轉(zhuǎn)化為有效的硬件設(shè)計(jì)，考慮性能、資源利用和時(shí)序約束。
3.使用主流FPGA開發(fā)工具（如Xilinx Vivado、Intel Quartus）進(jìn)行設(shè)計(jì)、綜合、布局和布線。
4.進(jìn)行FPGA的功能驗(yàn)證和仿真，優(yōu)化FPGA設(shè)計(jì)以提高性能、資源利用和功耗效率，進(jìn)行時(shí)序分析和時(shí)序約束設(shè)置，以確保設(shè)計(jì)滿足時(shí)序要求。
5.配合團(tuán)隊(duì)成員（如硬件工程師、軟件工程師和系統(tǒng)工程師）合作，實(shí)現(xiàn)綜合解決方案。
2.分析系統(tǒng)需求，將其轉(zhuǎn)化為有效的硬件設(shè)計(jì)，考慮性能、資源利用和時(shí)序約束。
3.使用主流FPGA開發(fā)工具（如Xilinx Vivado、Intel Quartus）進(jìn)行設(shè)計(jì)、綜合、布局和布線。
4.進(jìn)行FPGA的功能驗(yàn)證和仿真，優(yōu)化FPGA設(shè)計(jì)以提高性能、資源利用和功耗效率，進(jìn)行時(shí)序分析和時(shí)序約束設(shè)置，以確保設(shè)計(jì)滿足時(shí)序要求。
5.配合團(tuán)隊(duì)成員（如硬件工程師、軟件工程師和系統(tǒng)工程師）合作，實(shí)現(xiàn)綜合解決方案。
任職資格：
1.學(xué)士或碩士學(xué)位，專業(yè)為電子工程、計(jì)算機(jī)工程或相關(guān)領(lǐng)域。
2.至少5年以上FPGA設(shè)計(jì)和開發(fā)經(jīng)驗(yàn)，有成功交付多個(gè)項(xiàng)目的經(jīng)驗(yàn)。
3.熟練掌握主流FPGA開發(fā)工具，如Xilinx Vivado或Intel Quartus。深入了解FPGA架構(gòu)、資源利用和時(shí)序約束，能夠優(yōu)化性能和資源使用。
4.精通硬件描述語言，如Verilog和VHDL，能夠編寫高質(zhì)量、可維護(hù)的代碼。
5.在通信、圖像處理、高性能計(jì)算等領(lǐng)域有深入的應(yīng)用經(jīng)驗(yàn)。能夠分析復(fù)雜的系統(tǒng)級(jí)需求，將其轉(zhuǎn)化為有效的硬件設(shè)計(jì)。熟悉嵌入式系統(tǒng)和微控制器，能夠?qū)PGA集成到嵌入式平臺(tái)中。
2.至少5年以上FPGA設(shè)計(jì)和開發(fā)經(jīng)驗(yàn)，有成功交付多個(gè)項(xiàng)目的經(jīng)驗(yàn)。
3.熟練掌握主流FPGA開發(fā)工具，如Xilinx Vivado或Intel Quartus。深入了解FPGA架構(gòu)、資源利用和時(shí)序約束，能夠優(yōu)化性能和資源使用。
4.精通硬件描述語言，如Verilog和VHDL，能夠編寫高質(zhì)量、可維護(hù)的代碼。
5.在通信、圖像處理、高性能計(jì)算等領(lǐng)域有深入的應(yīng)用經(jīng)驗(yàn)。能夠分析復(fù)雜的系統(tǒng)級(jí)需求，將其轉(zhuǎn)化為有效的硬件設(shè)計(jì)。熟悉嵌入式系統(tǒng)和微控制器，能夠?qū)PGA集成到嵌入式平臺(tái)中。
工作地點(diǎn)
蘇州工業(yè)園區(qū)-若水路388號(hào)
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