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崗位職責(zé)：
1.負(fù)責(zé)復(fù)雜芯片版圖設(shè)計、布局和優(yōu)化，確保設(shè)計符合技術(shù)規(guī)范、DRC要求及性能目標(biāo)。
2.負(fù)責(zé)開發(fā)和維護(hù)高效的Skill腳本，自動化版圖設(shè)計流程，提高設(shè)計和驗證的效率與準(zhǔn)確性。
3.與電路設(shè)計團(tuán)隊、驗證團(tuán)隊緊密合作，針對具體需求優(yōu)化腳本，解決實際設(shè)計中的問題。
4.精通版圖設(shè)計中的各種自動化工具與方法，如DRC檢查、規(guī)則導(dǎo)入、版圖修改等。
5.在復(fù)雜項目中提供技術(shù)支持，提出優(yōu)化方案，持續(xù)提高設(shè)計效率和質(zhì)量。
參與版圖工具鏈的構(gòu)建與升級，推動版圖設(shè)計流程的創(chuàng)新和技術(shù)引領(lǐng)。
任職要求：
1.電子工程、集成電路設(shè)計或相關(guān)專業(yè)本科及以上學(xué)歷。
2.至少3年及以上版圖設(shè)計經(jīng)驗，精通并有豐富經(jīng)驗的Skill腳本編寫與應(yīng)用。
3.深入了解Cadence等EDA工具和版圖設(shè)計流程，熟悉芯片版圖設(shè)計、DRC檢查、規(guī)則導(dǎo)入等技術(shù)。
4.精通Skill腳本的開發(fā)、調(diào)試、優(yōu)化，能夠針對復(fù)雜設(shè)計問題快速編寫高效的腳本。
5.具備解決復(fù)雜版圖設(shè)計問題的能力，能夠高效完成設(shè)計任務(wù)。
6.有成功的自動化腳本開發(fā)經(jīng)驗者優(yōu)先，有大規(guī)模芯片設(shè)計經(jīng)驗者優(yōu)先。
7.良好的團(tuán)隊合作能力和溝通能力，能夠與跨團(tuán)隊合作，推動項目進(jìn)展。