職位描述
System VerilogVHDL
1、通過FPGA來實現(xiàn)各類數(shù)字接口創(chuàng)新方案的原型開發(fā)
2、完成各類數(shù)字IP模塊的開發(fā)、調測和驗證
3、建立FPGA器件性能、功耗模型、對應用進行優(yōu)化
3、建立FPGA器件性能、功耗模型、對應用進行優(yōu)化
任職要求：
1、能夠使用VERILOG/VDHL等描述語言、編寫邏輯功能，并實現(xiàn)功能仿真和調試
2、能夠使用基本的實驗室儀器設備
3、電子相關專業(yè)、掌握數(shù)字電路和數(shù)字通信等基礎知識
4、熟悉常用的接口和總線設計，并掌握一定的高速信號完整性和EMC設計方面的知識
2、能夠使用基本的實驗室儀器設備
3、電子相關專業(yè)、掌握數(shù)字電路和數(shù)字通信等基礎知識
4、熟悉常用的接口和總線設計，并掌握一定的高速信號完整性和EMC設計方面的知識
工作地點
金橋
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